REED SOLOMON ENCODER SIMULATION IN ACCORDANCE WITH G709

Hosein Salehi Azad, Amir Abbas Heydari

Resumen


In transmission of information from one place to other place such as computer network or sending information between different components of a computer system, it is possible that information be changed in the way because of presence of electromagnetic waves and thousands of other reasons.  One of the ways to deal with the noises in communication channels and storage systems is to use code control errors. Reed Solomon code is one of the most famous kind of these codes. So the aim of the present study is to simulate Reed Solomon encoder according to G 709. This paper presents an implementation for the encoder and the decoder of optical communication systems, according to the ITU-T G.709 standard. It presents an approach that multiplexes the traditional decoder blocks. The implementation promotes an expressive area reduction in an FPGA. It also presents the circuit implementation in a Virtex 5 FPGA, using software Xilinx ISE 10.1 tools.

Simulación de codificador de sistema Solomon de conformidad con G709

Abstract:

En la transmisión de información de un lugar a otro, como una red informática o el envío de información entre diferentes componentes de un sistema informático, es posible que la información se modifique debido a la presencia de ondas electromagnéticas y otras razones. Una de las formas de lidiar con los ruidos en los canales de comunicación y los sistemas de almacenamiento es usar códigos de control de errores. El código de Reed Solomon es uno de los mas conocidos. Por lo tanto, el objetivo del presente estudio es simular el codificador Reed Solomon de acuerdo con G 709. Este documento presenta una implementación para el codificador y el decodificador de sistemas de comunicación óptica, según el estándar ITU-T G.709. Presenta un enfoque que multiplexa los bloques decodificadores tradicionales. La implementación promueve una reducción del área expresiva en un FPGA. También presenta la implementación del circuito en un Virtex 5 FPGA, utilizando el software Xilinx ISE 10.1 herramientas.


Palabras clave


simulation, Reed Solomon, G 709, Decoder. Simulación, Reed Solomon, G 709, Decoder.

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